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注意：Core1 上跑控制任务时，若使用 ADC/DAC 等外设，需确认中断分配。建议将外设中断也绑定到 Core1，避免跨核中断延迟。

2026-09-27

如果 DMA 缓冲区不大，直接放 DTCM 也行，DTCM 不被 Cache，但注意 DMA 能否访问 DTCM 取决于总线矩阵，一般 MDMA 可以，普通 DMA 不行。

2026-09-21

实测Write-Through比Non-Cacheable性能好很多，尤其对SDRAM。但Write-Through下CPU写操作仍会更新Cache，DMA读之前必须Clean。

2026-09-20

如果使用STM32CubeMX生成的代码，注意在回调函数中不要直接操作DMA句柄，而是通过标志位通知主循环处理，这样更安全，避免中断嵌套问题。

2026-08-27