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实操中，建议在固件中存储校准系数，并在每次上电时重新校准，因为温度变化会影响VREFINT和ADC性能。可结合温度传感器做动态补偿。

2026-08-27

注意ADC采样时间设置：若采样率过高，DMA传输可能跟不上，导致溢出。建议用定时器触发ADC，并计算采样周期确保DMA带宽足够。

2026-08-27

可考虑使用DMA的FIFO功能（若支持）来缓冲数据，减少总线占用，但F4系列DMA无FIFO，需靠对齐和双缓冲优化。

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超时时间别设太短，尤其高速率下，建议根据波特率计算：超时=3个字符时间。另外，DMA中断里别做解析，只做标记，主循环处理数据更安全。

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注意：ESP32-S3的ADC已改进，无需此技巧；若用ESP32，记得关闭WiFi干扰，否则ADC噪声会恶化。

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补充：若使用外部晶振，确认HSE频率准确，因为FMC时序基于HCLK，晶振偏差会放大错误。可改用内部PLL校准。

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若处理时间不可控，可考虑增加缓冲区大小或降低DMA速率，或者使用FIFO机制，但双缓冲本身已能缓解，关键是中断优先级设置要高。

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采样时刻精确性可依赖定时器触发，但中断延迟会引入抖动。若需纳秒级精度，可考虑使用ADC的注入组或外部触发，并在DMA中断中读取TIM->CNT作为时间戳，但需注意中断优先级和临界区保护。

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注意ADC采样时间设置，确保在触发边沿后采样保持时间足够，否则数据可能不准确。可调整采样周期与定时器频率匹配。

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实际中，建议将缓冲区放在D2 RAM（如F4/F7）或紧耦合内存，减少总线冲突，并启用DMA的FIFO模式以优化传输效率。

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