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若抖动源于中断延迟，可尝试将DMA中断优先级设为低于PWM更新中断，并确保DMA传输在PWM更新前完成（通过调整DMA请求时机或使用突发传输）。

2026-08-29

可以开启ADC的DMA请求的硬件同步，使用ADC的注入通道或规则通道的序列寄存器，确保每次转换序列完整，再配合DMA的突发传输模式减少中断开销。

2026-08-27

补充：若通道数较多，可考虑使用ADC的注入组配合DMA，但更推荐用规则组+双缓冲，简单可靠。

2026-08-27

补充：在DMA中断中，务必先禁用DMA（DMA_Cmd(DMAx, DISABLE)）再操作缓冲区，处理完重新使能，防止CPU与DMA同时访问导致数据撕裂。

2026-08-27

实测中，开启DCache（数据缓存）后，需确保DMA与外设访问的一致性，否则可能引发随机死机。建议对共享内存区域使用MPU配置为非缓存。

2026-08-27

实测中，ART缓存命中率对功耗影响最大，建议用性能计数器监控未命中率，若低于5%可考虑减小预取深度。

2026-08-27

除了SRAM重定位，还可以用Flash的预取缓冲区（Prefetch Buffer）和指令缓存（I-Cache）优化，但注意缓存命中率，必要时禁用中断期间的缓存刷新。

2026-08-27

用调试器在唤醒中断处设断点，若未触发，重点查EXTI线17配置和PWR_CR的CWUF位，有时需要软件清除唤醒标志才能再次进入。

2026-08-27

注意DMA传输完成中断和更新中断可能同时触发，建议在DMA中断中关闭更新中断，处理完再开启，或者用双缓冲避免数据撕裂。

2026-08-27