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检查DMA配置的MSP和PSP，确保缓冲区地址对齐到32位，并开启DMA的FIFO模式，减少总线竞争导致的时序抖动。

2026-09-03

若硬件支持，可配置中断优先级分组，将ISR分为快速响应和慢速处理两类，慢速ISR用信号量委托任务，避免长时间关中断影响系统实时性。

2026-08-27

注意缓存行对齐：将读写索引分别放在不同缓存行，避免伪共享（false sharing），尤其在多核MCU上性能差异显著。

2026-08-27

注意：DMA双缓冲的地址必须物理连续且对齐，建议使用__attribute__((aligned(32)))定义数组，否则MPU设置可能无效，导致随机性错误。

2026-08-27

注意DMA的传输宽度要与CCR寄存器匹配（16位），并设置内存地址递增，外设地址固定，否则会覆盖错误寄存器。

2026-08-27

补充：设计时需考虑任务优先级反转，若低优先级任务被中断频繁抢占，可提高任务优先级或使用事件组，但确保中断响应时间可控。

2026-08-27

注意缓存一致性，若MCU带D-Cache，需在ISR写后clean，任务读前invalidate，否则数据可能错乱。

2026-08-27

若使用RTC唤醒，确认备份域寄存器（RTC->ISR的ALRAF）在唤醒后立即清零，否则会重复触发。可加延时或软件去抖。

2026-08-27

注意：STM32F4的DMA2支持内存到内存，但双缓冲常用于外设到内存。若外设是SDIO或以太网，需额外处理FIFO和突发模式，屏障位置要放在外设请求之后。

2026-08-27

建议开启USB的DMA错误中断和CRC错误统计，结合调试日志区分是硬件噪声还是FIFO问题，必要时增加硬件重试机制。

2026-08-27