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RTOS · 潘东芯片应用 · 4 回答 · 129 浏览

在 FreeRTOS 中，ISR 里必须用 xQueueSendFromISR（或 xQueueSen...

ESP32 · 杜博文智能硬件 · 4 回答 · 128 浏览

ESP32-S3 双核下，Wi-Fi 任务与 ADC 采样绑核后仍会因共享 Cache...

STM32 · 曹雪嵌入式软件 · 4 回答 · 181 浏览

核心思路：把定时器配置为从模式复位（Slave Mode Reset），触发...

ESP32 · 于洁测硬件 · 4 回答 · 144 浏览

在ESP32-S3双核（Xtensa LX7）上，用FreeRTOS任务通知替代队列做...

ESP32 · 杜博文智能硬件 · 4 回答 · 60 浏览

ESP32-S3 是双核 Xtensa LX7，默认 Wi-Fi 协议栈跑在 Core0，应...

STM32 · 于洁测硬件 · 4 回答 · 80 浏览

这是H7上非常经典的坑。核心原则：DMA写内存（外设→内存）时，CP...

RTOS · 崔健物联网 · 4 回答 · 135 浏览

在FreeRTOS中，ISR中必须使用带FromISR后缀的API，且需满足边界...

STM32 · 崔健物联网 · 4 回答 · 77 浏览

STM32H7 的 Cortex-M7 带 D-Cache，DMA 与 CPU 共享内存时必须显...

ESP32 · 石磊芯片维修 · 4 回答 · 108 浏览

ESP32-S3 的 Wi-Fi 任务固定到 Core0 只解决了 CPU 调度层面的竞...

STM32 · 曹雪嵌入式软件 · 4 回答 · 100 浏览

这是典型的Cache一致性问题：DMA直接写内存，而CPU可能从D-Cache...

STM32 · 田甜单片机教学 · 4 回答 · 79 浏览

STM32H7 开启 D-Cache 后，DMA 直接访问物理内存而 CPU 可能读到...

ESP32 · 潘东芯片应用 · 4 回答 · 81 浏览

ESP32-S3 双核（PRO_CPU/APP_CPU）共享 L1 Cache 与 PSRAM，伪共...

STM32 · 蒋琴FPGA · 4 回答 · 74 浏览

STM32H7的D-Cache与DMA配合时，操作顺序错误会引发两类典型故障...

STM32 · 崔健物联网 · 4 回答 · 72 浏览

STM32H7 的 Cortex-M7 带 D-Cache，DMA 与 CPU 共享内存时若不维...

STM32 · 马超嵌入式 · 4 回答 · 67 浏览

这是H7上D-Cache与DMA共享SRAM时的经典一致性问题，核心是两点：...